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当前位置: 首页 资源下载 搜索资源 - Hexadecimal count

搜索资源列表

  1. COUNT

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  2. 这是一个十六进制的加减计数器源代码,把其修改一下就可以用其他进制了-This is a hexadecimal addition and subtraction counter source code, its change it can use other hex of the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:283402
    • 提供者:max
  1. counter24

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  2. 24进制计数,可以执行异步复位。该文件包含整个项目-24 hexadecimal counting, can perform asynchronous reset. This document contains the entire project
  3. 所属分类:Windows Develop

    • 发布日期:2017-12-03
    • 文件大小:180845
    • 提供者:iyoung
  1. menglongyu30

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  2. 模为12计数器 时钟电路需用到,能实现12进制的计数-Counter mode clock circuit 12 may need to rely on, to achieve a count of 12 hexadecimal
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-08
    • 文件大小:16957
    • 提供者:王雨
  1. timer

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  2. 能够实现小时(24进制)、分钟和秒钟(60进制)的计数功能 具有复位功能 功能扩展:具有整点报时提示、定时闹钟等功能 -To achieve an hour (24 hexadecimal), minutes and seconds (60 hexadecimal) count function function reset function expansion: with the whole point timekeeping tips, regular features such
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:664212
    • 提供者:doraemon
  1. xunhuan

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  2. (1)编写分支结构.asm文件实现: 键盘输入以‘$’为结束符的长度不超过80的字符串(含字母、数字、其他字符),对其中的非数字字符计数。统计结果用十六进制数屏幕显示。 (2)编写分支结构.asm文件实现: 定义一串以‘$’结束的字符串,给每一个字符均加上偶校验位。统计有多少个字符因含有奇数个1而加上了校验位,结果存入N单元。 -(1) the preparation of branch structure. Asm file to achieve: keyboard input in
  3. 所属分类:assembly language

    • 发布日期:2017-03-29
    • 文件大小:36668
    • 提供者:李平
  1. 1

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  2. 问题描述: 一本书的页码从自然数1 开始顺序编码直到自然数n。书的页码按照通常的习惯编排,每个页码都不含多余的前导数字0。例如,第6 页用数字6 表示,而不是06 或006 等。数字计数问题要求对给定书的总页码n,计算出书的全部页码中分别用到多少次数字0,1,2,…,9。 编程任务: 给定表示书的总页码的10 进制整数n (-Descr iption of the problem: the page of a book from the natural number 1 unt
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-12
    • 文件大小:520
    • 提供者:yuecuiping
  1. counter16

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  2. 利用simulink制作的十六进制计数器-Simulink produced using hexadecimal counter
  3. 所属分类:matlab

    • 发布日期:2017-04-02
    • 文件大小:7599
    • 提供者:程诗宇
  1. shumaxianshi

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  2. 系统上电后会有提示音,并且数码管显示0。K1键使数码管进行十六进制减1计数显示,K2键使数码管进行十六进制加1计数显示。数码管显示的同时,发光两极管将显示对应的二进制数。亮表示1,灭表示0-Power system will be prompted after the tone and digital display 0. K1 key for digital control by a count of hexadecimal display, K2 keys for digital contr
  3. 所属分类:SCM

    • 发布日期:2017-04-06
    • 文件大小:18224
    • 提供者:sunbin
  1. b4-1.8

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  2. 大数相乘基本算法,相当于模拟手算。使用GMP生成指定数位的01串大数,将生成的01串用char型截取,运算中其实是以一次取4位进行运算。相当于16进制运算。-Multiplication of large numbers of basic algorithms, equivalent to simulate hand count. GMP is generated using the specified digit string of 01 large numbers, will generat
  3. 所属分类:Algorithm

    • 发布日期:2017-03-28
    • 文件大小:3405
    • 提供者:Ivy
  1. jianyishuzizhong

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  2. 一个简易的数字钟,能显示小时、分和秒,是一台按秒计数并显示的计时器,其中秒和分为60进制,小时为24进制计数。-A simple digital clock showing the hours, minutes and seconds, is one count per second and displays the timer, which is divided into 60 seconds, and decimal, hexadecimal count for 24 hours.
  3. 所属分类:SCM

    • 发布日期:2017-04-24
    • 文件大小:10392
    • 提供者:刘逊
  1. DF2C8_03_NixeTube

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  2. :8 个数码管从 0 开始计数,每次增加 1;每位显示的字符包括从 “0~F”16 个十六进制数;  按下复位按键之后,计数从 0 重新开始。由此可验证数码管、有 源时钟和复位按键等功能。-: 8 digital tube starts counting from 0, for each increase of 1 each displayed character from " 0 ~ F" 16 hexadecimal numbers press the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:732324
    • 提供者:qiutian
  1. led

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  2. AT89C2051驱动6位共阴LED管 并将计数65535 每位扫1ms,定时0, 加了码表0-9,其中p1.7\a,,,,,p1.0\h 50h,,,54h,个,十,百,千,万 40h十六进制低位,41十六进制高位-AT89C2051 drive common cathode LED Tube 6 6 AT89C2051 common cathode LED driver tube and count 65535 each sweep 1m
  3. 所属分类:SCM

    • 发布日期:2017-04-10
    • 文件大小:1163
    • 提供者:ZHAO
  1. SocketTest

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  2. 实现Client Socket及其SeverSocket,实现启动 停止 16进制发送,发送计数 传输速率等-implement Client Socket and SeverSocket, to implement start, stop ,sending hexadecimal, send count, transmission rate
  3. 所属分类:WinSock-NDIS

    • 发布日期:2017-04-07
    • 文件大小:132450
    • 提供者:毛继科
  1. cnt16anddisplay

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  2. 源代码实现十六进制的显示,包括三个模块:分频、计数、显示。适合vhdl的初级读者以及在校大学生-Source code in hexadecimal display, consists of three modules: frequency, count, display. Vhdl for primary readers and college students
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4054
    • 提供者:刘海亮
  1. CPLD

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  2. 设计一个6进制递增计数器,计数信号通过K0产生并输入。计数结果利用试验仪上的数码管LED2显示。-Design a 6 hexadecimal increment the counter, and enter the count signal generated by K0. Count results on the tester digital tube display LED2.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-17
    • 文件大小:99047
    • 提供者:张宇
  1. sy1(1)

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  2. 每按一次按键,累计按键次数并通过LED显示出来,且采用16进制计数。-Each time you press the button, the cumulative number of keystrokes and through the LED display and hexadecimal count.
  3. 所属分类:SCM

    • 发布日期:2017-11-24
    • 文件大小:15838
    • 提供者:钟建新
  1. huibian

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  2. 汇编初学者的一些基本实验:字符串的比较;十六进制与二进制的转换;字符和数据的计数等共8个试验-Some basic experimental assembly for beginners: string comparison hexadecimal and binary conversion characters and data count of eight trials
  3. 所属分类:assembly language

    • 发布日期:2017-11-21
    • 文件大小:7568
    • 提供者:fmoet
  1. Debug

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  2. 计算51计数初值选择定时方式,再给定晶振,得出高低16进制数。-Initial calculations 51 count timing mode selected, give a given crystal, the level reached in hexadecimal.
  3. 所属分类:source in ebook

    • 发布日期:2017-04-04
    • 文件大小:197532
    • 提供者:于洋
  1. led_24_terminal

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  2. 这是一段用VHDL语言写的24进制计数器,用数码管显示,我用了例化语句,分为24进制计数器模块,十位译码,个位译码,用cycloneII ep2系列实验板验证,能计数0~23。此程序还可以修改为100以内任何进制计数器。-This is a written in VHDL language 24 a binary counter, using digital tube display, I used the instantiated statements, divided into 24 hex
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:352802
    • 提供者:高安
  1. dianzhen

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  2. 需要实现点阵按列依次并且循环显示的效果,可以分析视觉上可以观察到列的变化,则列的扫描频率必定要远远小于行扫描的频率。在程序中,设置行扫描的频率等于前次实验中数码管扫描的频率,设置列扫描的频率为5HZ,即每0.2s显示亮的一列向前推进一列。在程序中,使用16进制计数作为74HC154的输入:分出5hz的频率,并用其计数,将计数值作为74HC154,则其译码产生的输出变化也为5hz,并且实现每列一次选通。由于每行对应的数码管共阳极。直接赋高电平。则可以实现所需要的功能。行扫面则是要实现先依行点亮,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:728258
    • 提供者:丁明凯
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